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逻辑设计工程师（数字前端）

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  • 10万-20万/年
  • 无锡
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  • 3年以上
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  • 本科
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  • 全职

职位诱惑: 年终奖金,五险一金,福利好,成长空间大

发布时间: 2020-02-26发布

职位描述

岗位职责：
1.组织、管理项目整体运行
2、完成项目的逻辑设计 
3、撰写研发过程文档
4、完成部门安排的其他工作
岗位要求：
1.熟悉Verilog等逻辑设计语言
2.掌握Cadence、Synopsys等IC设计软件的基本使用，如hsim、VCS、NC等
3.具有ASIC开发经验优先

职位发布者

顾敏捷

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无锡建筑西路777号国家集成电路设计中心B区

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