- 15万-30万/年
- 无锡
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- 3年以上
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- 本科
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- 全职
职位诱惑: 年终奖金,五险一金,福利好,成长空间大
发布时间: 2020-02-26发布
职位描述
职责描述
1、实现系统要求分析,对设计进行模块分割、接口定义；
2、负责算法映射与芯片架构探索；
3、RTL设计实现；基于面积、时序要求的优化设计；设计报告编写。
4、基于验证结果，分析排错；
5、负责相关文档、报告的撰写、归档。
职位要求
1、电子、通信、计算机相关专业3年以上工作经验
2、熟练操作计算机、前端EDA工具；
3、熟悉微处理器体系结构，熟悉面向硬件架构的算法映射，熟练掌握面向实现的RTL级设计；
4、熟练掌握数字电路设计、数字电路综合技术；
5、能够针对RTL/netlist进行时序、功耗、面积和电路性能的优化；
6、熟练掌握verilog硬件描述语言，善于学习。
职位发布者
顾敏捷
HR
7天
简历处理用时
100%
简历及时处理率
沪公网安备31011502017136号